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 Stitching FPGA Dies into a Unified Pipeline for Seismic Stencil Acceleration. <em>In</em>: ESCOLA REGIONAL DE ALTO DESEMPENHO DE SÃO PAULO (ERAD-SP), 17.	, 2026, São Paulo/SP.
	 
	<strong>Anais</strong> [...].
 Porto Alegre: Sociedade Brasileira de Computação, 
	2026
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 p. 13-16. 
		DOI: <a href="https://doi.org/10.5753/eradsp.2026.30776">https://doi.org/10.5753/eradsp.2026.30776</a>.