Proposta de implementação do algoritmo SHA-256 em Hardware

  • Carlos E. B. Santos Júnior
  • Marcelo A. C. Fernandes

Resumo


Este trabalho propõe uma arquitetura desenvolvida em Field Programmable Gate Array (FPGA) para o algoritmo de hash SHA-256. O SHA-256 ´e bastante usado em protocolos para transporte de dados seguros ou verifica¸cão de integridade, como o HMAC, TLS e IPSec. A implementação proposta neste artigo traz uma abordagem diferenciada em relação a outros trabalhos j´a publicados, com núcleos agrupados executando o algoritmo SHA-256 em paralelo. Alcan¸cando um throughput de 0, 80847Gbps para umaúnico núcleo e em torno de 101Gbps para 128 núcleos em umúnico FPGA. Existe uma grande possibilidade de aplica¸cões para tal implementa¸cão, a qual utilizou como FPGA alvo o Xilinx Virtex 6 xc6vlx240t1ff1156.
Publicado
25/10/2018
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JÚNIOR, Carlos E. B. Santos; FERNANDES, Marcelo A. C.. Proposta de implementação do algoritmo SHA-256 em Hardware. In: SIMPÓSIO BRASILEIRO EM SEGURANÇA DA INFORMAÇÃO E DE SISTEMAS COMPUTACIONAIS (SBSEG) , 2018 Anais do XVIII Simpósio Brasileiro em Segurança da Informação e de Sistemas Computacionais. Porto Alegre: Sociedade Brasileira de Computação, oct. 2018 . p. 17 - 24.