O Efeito da Latência no Desempenho da Arquitetura DTSVLIW

  • Fernando Líbio L. Almeida UFES
  • Alberto F. De Souza UFES
  • Christian Daros de Freitas UFES
  • Neyval Costa Reis Jr. UFES

Resumo


Neste trabalho apresentamos resultados experimentais que mostram o forte impacto da latência das instruções e da hierarquia da memória no desempenho da arquitetura DTSVLIW. A latência das instruções reduz o desempenho DTSVLIW quando executando programas inteiros do SPEC2000 em 32.0% e, surpreendentemente, em apenas 6.2% no caso de programas de ponto flutuante, muito embora os últimos requeiram a execução de um número muito maior de instruções com altas latências. A latência da hierarquia de memória tem um forte impacto no desempenho da DTSVLIW para programas inteiros - redução de 22,1% - mas ainda maior para programas de ponto flutuante - redução de 85.5%. Estes resultados sugerem trabalhos futuros em técnicas para redução do impacto da latência no desempenho DTSVLIW.

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Publicado
10/11/2003
ALMEIDA, Fernando Líbio L.; SOUZA, Alberto F. De; FREITAS, Christian Daros de; REIS JR., Neyval Costa. O Efeito da Latência no Desempenho da Arquitetura DTSVLIW. In: SIMPÓSIO EM SISTEMAS COMPUTACIONAIS DE ALTO DESEMPENHO (SSCAD), 4. , 2003, São Paulo. Anais [...]. Porto Alegre: Sociedade Brasileira de Computação, 2003 . p. 64-71. DOI: https://doi.org/10.5753/wscad.2003.19104.