Arquitetura de Memória Cache Reconfigurável

  • Milene B. Carvalho PUC Minas / Universidade de Itaúna
  • Carlos A. P. S. Martins PUC Minas

Resumo


Neste artigo apresentamos uma arquitetura de memória cache reconfigurável. Além disso, apresentamos a taxa de acerto de algumas cargas de trabalho reais do SPEC 2000 CPF representadas por traces obtidos do BYU Trace Distribution Center executadas em nossa arquitetura e nas organizações tradicionais de cache. Com a análise dos resultados destes experimentos, foi possível concluir que com o mesmo número de comparadores, a cache reconfigurável possui uma taxa de acerto superior a uma cache fixa, na maioria dos casos. Nossa principal contribuição é a proposta de uma arquitetura de memória cache reconfigurável capaz de se adaptar às diferentes cargas de trabalho e a análise de seu comportamento.

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Publicado
17/10/2006
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CARVALHO, Milene B.; MARTINS, Carlos A. P. S.. Arquitetura de Memória Cache Reconfigurável. In: SIMPÓSIO EM SISTEMAS COMPUTACIONAIS DE ALTO DESEMPENHO (SSCAD), 7. , 2006, Ouro Preto. Anais [...]. Porto Alegre: Sociedade Brasileira de Computação, 2006 . p. 136-143. DOI: https://doi.org/10.5753/wscad.2006.18957.